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| ファイル | 記述 | サイズ | フォーマット | |
|---|---|---|---|---|
| djohk00761.pdf | Dissertation_全文 | 1.57 MB | Adobe PDF | 見る/開く |
| yjohk00761.pdf | Abstract_要旨 | 218.84 kB | Adobe PDF | 見る/開く |
| タイトル: | Energy-Efficient On-Chip Cache Architectures and Deep Neural Network Accelerators Considering the Cost of Data Movement |
| その他のタイトル: | データ移動コストを考慮したエネルギー効率の高いキャッシュアーキテクチャとディープニューラルネットワークアクセラレータ |
| 著者: | Xu, Hongjie |
| 著者名の別形: | 徐, 宏傑 |
| キーワード: | Low Power VLSI Design Deep Neural Network Parallel Processing Sparsity Hardware Accelerator |
| 発行日: | 23-Mar-2021 |
| 出版者: | Kyoto University |
| 記述: | 付記する学位プログラム名: 京都大学卓越大学院プログラム「先端光・電子デバイス創成学」 |
| 学位授与大学: | 京都大学 |
| 学位の種類: | 新制・課程博士 |
| 取得分野: | 博士(情報学) |
| 報告番号: | 甲第23325号 |
| 学位記番号: | 情博第761号 |
| metadata.dc.date.granted: | 2021-03-23 |
| 請求記号: | 新制||情||130(附属図書館) |
| 研究科・専攻: | 京都大学大学院情報学研究科通信情報システム専攻 |
| 論文調査委員: | (主査)教授 小野寺 秀俊, 教授 大木 英司, 教授 佐藤 高史 |
| 学位授与の要件: | 学位規則第4条第1項該当 |
| 著作権等: | 1.Hongjie Xu, Jun Shiomi and Hidetoshi Onodera, Evaluation Metrics for the Cost of Data Movement in Deep Neural Network Acceleration, IEICE TRANSACTIONS on Fundamentals of Electronics, Communications and Computer Sciences, 2021/06 2.Hongjie Xu, Jun Shiomi and Hidetoshi Onodera, MOSDA: On-chip Memory Optimized Sparse Deep Neural Network Accelerator with Efficient Index Matching, IEEE Open Journal of Circuits and Systems, 2020/12 3.Hongjie Xu, Jun Shiomi and Hidetoshi Onodera, On-chip Memory Optimized CNN Accelerator with Efficient Partial-sum Accumulation, The 30th edition of the ACM Great Lakes Symposium on VLSI (GLSVLSI), 2020/09 4.Hongjie Xu, Jun Shiomi, Tohru Ishihara and Hidetoshi Onodera, On-Chip Cache Architecture Exploiting Hybrid Memory Structures for Near-Threshold Computing, IEICE TRANSACTIONS on Fundamentals of Electronics, Communications and Computer Sciences, vol E102-A, no 12, pp. 1741-1750, 2019/12 5.Hongjie Xu, Jun Shiomi, Tohru Ishihara, and Hidetoshi Onodera, Maximizing Energy Efficiency of On-Chip Caches Exploiting Hybrid Memory Structure, 28th International Symposium on Power and Timing Modeling, Optimization and Simulation (PATMOS), pp. 237 - 242, DOI: 10.1109/PATMOS.2018.8464141, 2018/07 |
| DOI: | 10.14989/doctor.k23325 |
| URI: | http://hdl.handle.net/2433/263786 |
| 関連リンク: | https://doi.org/10.1109/PATMOS.2018.8464141 |
| 出現コレクション: | 140 博士(情報学) |
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